时序验证造句

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一种借助时序检测系统进行时序验证的方法
采用了硬件描述语言verilog对整个相关继承矢量量化图像编码电路系统在cadence系统上进行了西安理工大学硕士论文设计、仿真及时序验证。
本论文在对相关矢量量化图像编码算法进行深入分析的基础上，在两个方面提出了基于vlsi技术的新算法，并进行了vlsi硬件设计、模拟仿真和时序验证。
本文研制了10bit和12bit两种精度的基于模型参考自适应的速度估算ip核，并进行功能和时序验证，比较了它们所占用的芯片资源的大小， max + plus的仿真确定了实际的电路硬件结构。
该mvbc系统设计采用业界通用的自上而下的eda设计方法,电路逻辑实现采用veriloghdl硬件语言描述,功能和时序验证的动态仿真采用synopsys公司的vcs ,而逻辑综合与fpga实现采用altera公司的集成开发环境quartusii软件以及stratixiiep2s15的fpga器件。
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其他语种

时序验证的英语：timing verification

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